Bei der Planung und Realisierung von Regelungs- und Steuerungsaufgaben mit Verknüpfungen wie UND, ODER, XOR, sowie direkten Verbindung zwischen Eingang und Ausgang, ändert sich der Ausgangsoperand (Ausgang) immer parallel zum Eingangsoperanden (Eingang). Gut in der Simulation von KincoBuilder zu sehen. Im Oberen "Network" ist der Eingang geschlossen, deshalb ist der Ausgang aktiv also eingeschaltet. Sobald der Eingang wie im "Network" 2 zu sehen geöffnet ist, ist der Ausgang nicht mehr aktiv also ausgeschaltet. In aller Regel braucht man beim programmieren von SPS aber eine Speicherung von Zuständen. Setzen und Rücksetzen in FUP. Wenn sich der Eingang ändert, soll der Ausgang den aktuellen Zustand beibehalten (speichern). Besonders bei der Flankenauswertung wird ein "speicherndes Verhalten" des Ausgangsoperanden gebraucht, da bei einer Flankenauswertung lediglich ein kurzzeitiges Signal geliefert wird. Um dieses speichern zu realisieren gibt es in SPS Programen sogenannte Speicherglieder. Über ein rücksetzen wird diese Speicherung wieder aufgehoben.
Nachfolgend ein Beispiel, in dem auch der Impulsoperand gesetzt wird. SR- und RS-Flipflops kann man auch nur mit dem Einsatz von UND- und ODER-Gliedern realisieren. Daher können Flankenauswertung auch nur mit den beiden Grundverknüpfung UND/ODER erstellt werden.
Bei dieser Variante kann ein Speicherglied nur gesetzt werden, wenn andere Speicherglieder bereits gesetzt wurden. Die Ausgangsoperanden werden UND-verknüpft an den Setzeingang eingetragen. So kann das Speicherglied nur gesetzt werden, wenn die anderen Speicherglieder bereits gesetzt wurden. In diesem Beispiel wird A0. 1 am Setzeingang von A0. Flipflops verrriegen: SR- und RS-Glieder verriegeln. 2 vorausgesetzt. Bei dieser Variante wird eine Reihenfolgeverriegelung über den Rücksetzeingang realisiert. Die Speicherglieder, die vorausgesetzt werden, trägt man ODER-verknüpft am Rücksetzeingang und negiert diese. Haben die vorausgesetzten Speicherglieder nicht das Signal 1, kann ein Speicherglied aufgrund der Rücksetzdominanz nicht gesetzt werden. In diesem Beispiel kann A0. 2 nicht gesetzt werden, solange A0. 1 ein Signal 0 liefert. Der Unterschied zwischen den beiden Varianten zur Reihenfolgeverriegelung ist, dass beim Verriegeln über den Setzeingang die Bedingung zum Setzen erst gar nicht gegeben ist, wenn die vorausgesetzten Speicherglieder nicht gesetzt wurden.
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